Infinity Cache para APU? AMD probablemente esté planeando algo mejor

Los editores del sitio web VideoCardz señalaron el código según el cual el tercer chip gráfico de la arquitectura RDNA 2 Navi 23, debe llevar 32 MB de Infinity Cache. Por lo tanto, será significativamente menor que en Navi 22 (Radeon RX 6700 XT) a Navi 21 (Radeon RX 6900 XT / 6800 [XT]), sin embargo, este núcleo apunta a un segmento de rendimiento más bajo y el ancho del bus es la mitad que el del modelo superior (Radeon RX 6900 XT), por lo que no habrá necesidad de compensar un déficit tan significativo en el rendimiento bruto de la memoria.

También aprendemos que las APU “pequeñas” van Gogh (para los que se suponía que Microsoft tenía exclusividad, pero que canceló o pospuso algunos productos) no estará equipado con Infinity Cache.

AYUDA van Gogh admitirá LPDDR5 muy rápido (estos están disponibles en la versión LPDDR5-5500 y también están siendo preparados por LPDDR5-6400). Hubo informes de incluso un bus de 256 bits, que se basó en un fondo real, pero probablemente fue una detección / recálculo falso y la realidad será más bien de 128 bits (4 canales, pero 32 bits). Sin embargo, lo que sigue siendo mucho para las relaciones APU de 9 W, significa un rendimiento de datos de 88 GB / s para LPDDR5-5500 y 102,4 GB / s para LPDDR5-6400. A modo de comparación: la APU móvil actual de 35 W Cezanne tiene un rendimiento de datos de 51,2 GB / s con conexión de dos canales del clásico DDR4-3200. 9W van Gogh con prácticamente el doble, no necesita Infinity Cache (así que de alguna manera creo que la mitad sería suficiente para él, pero ese sería un tema para otro artículo).

Infinity Cache en Navi 21

Sin embargo, según la filtración Bondrew, AMD está preparando un caché más grande para futuras APU, pero no solo será un Infinity Cache, sino también un SLC. Podríamos encontrar la abreviatura SLC ya en el contexto del SoC Apple M1, pero sería necesario señalar que este no es el primer producto con esta solución, sino el primer producto en el que se marcó con la abreviatura SLC.

Este acrónimo puede parecer un poco desafortunado, ya que evoca el significado de celda de un solo nivel utilizado en el contexto de la memoria Flash. Sin embargo, en el caso de SoC / APU, significa algo más. SLC significa System Level Cache y se refiere al caché de nivel superior al que todos (o al menos todos los componentes importantes de SoC / APU) tienen acceso. En nuestro contexto, por tanto, tanto la GPU como la CPU.

Por ejemplo, Intel ya ha utilizado SLC (caché de último nivel accesible tanto para el procesador como para los núcleos gráficos) en algunos de sus procesadores gráficos integrados. Sin embargo, no se puede decir que su implementación traiga alguna ventaja competitiva, APU AMD superó esta solución incluso sin ella. El problema probablemente radicaba en el hecho de que ni el procesador de Intel ni los núcleos gráficos eran tan potentes que el bus estándar los limitaba significativamente, por lo que la caché común de nivel superior tenía un impacto insignificante (más precisamente, no representaba una ventaja competitiva).

En el caso del Apple M1, no sabemos mucho sobre SLC. Apple no proporciona más detalles en las especificaciones disponibles públicamente, y también existe un debate sobre qué capacidad alcanza realmente. El personal editorial del sitio web de Arstechnica opina que es de 8 MB, el personal editorial del sitio web de Anandtech cree que es de 16 MB. En cualquier caso, se puede decir que según las medidas de Anandtech concebidas por los núcleos del procesador, el SLC en la mayoría de situaciones no tiene un impacto significativo en las transmisiones de datos y se manifiesta más bien en casos puntuales. Parece que el SLC M1 servirá principalmente a la GPU integrada, que tiene un rendimiento casi 2 veces mayor que la iGPU actual en el mundo de las PC x86, u otros circuitos integrados.

Esperamos que en el caso de las futuras APU AMD, Infinity Cache no se implemente en el sentido de chips gráficos separados, es decir, solo para las necesidades del núcleo gráfico, sino que será un SLC completo, es decir, el último nivel de caché. disponible para gráficos y núcleos de procesador. Como muestra el gráfico oficial, AMD también probó capacidades como 8 MB, 12 MB y 16 MB, que se pueden usar en el segmento de APU.

físico
permeable
IC
zona
IC ***
tasa de aciertos y rendimiento efectivo de IC (GB / s)
1920 × 10802560 × 14403840 × 2160
8 MB124 GB / s8 mm²25%3117%2114%17
12 MB186 GB / s12 mm²31%5819%3515 %28
16 MB248 GB / s16 mm²37%9225%6217%42
24 MB373 GB / s24 mm²48%17931%11624%90
32 MB497 GB / s32 mm²55%27339%19426%129
48 MB745 GB / s48 mm²66%49249%36534%253
64 MB993 GB / s64 mm²72%71559%58641%407
96 MB1490 GB / s96 mm²78%116266%98352%775
128 MB1987 GB / s128 mm²81%160974%147062%1232

La tabla muestra la conversión aproximada del gráfico (es decir, la situación en términos del núcleo gráfico) en valores numéricos. Nos dice que en una resolución de 1920 × 1080:

  • Infinity Cache de 16 MB aumentaría el rendimiento efectivo en ~ 92 GB / s en una resolución de 1920 × 1080 (con la DDR4-3200 de dos canales actual, que alcanza los 51,2 GB / s, sería un aumento del 180%)
  • Infinity Cache de 12 MB aumentaría el rendimiento efectivo en 58 GB / s (es decir, en un 113%)
  • Infinity Cache de 8 MB o 31 GB / s (tj. O 61%).

En el caso del uso como caché SLC, donde los núcleos del procesador ocuparían algo, claro, el aumento podría ser un poco menor. Sin embargo, AMD ciertamente podrá equilibrar de alguna manera el uso de este caché con respecto a principalmente gráficos y principalmente carga de procesador.


Source: Diit.cz by diit.cz.

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